Training courses
Kernel and Embedded Linux
Bootlin training courses
1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 33 34 35 36 37 38 39 40 41 42 43 44 45 46 47 48 49 50 51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83 84 85 86 87 88 89 90 91 92 93 94 95 96 97 98 99 100 101 102 103 104 105 106 107 108 109 110 111 112 113 114 115 116 117 118 119 120 121 122 123 124 125 126 127 128 129 130 131 132 133 134 135 136 137 138 139 140 141 142 143 144 145 146 147 148 149 150 151 152 153 154 155 156 157 158 159 160 161 162 163 164 165 166 167 168 169 170 171 172 173 174 175 176 177 178 179 180 181 182 183 184 185 186 187 188 189 190 191 192 193 194 195 196 197 198 199 200 201 202 203 204 205 206 207 208 209 210 211 212 213 214 215 216 217 218 219 220 221 222 223 224 225 226 227 228 229 230 231 232 233 234 235 236 237 238 239 240 241 242 243 244 245 246 247 248 249 250 251 252 253 254 255 256 257 258 259 260 261 262 263 264 265 266 267 268 269 270 271 272 273 274 275 276 277 278 279 280 281 282 283 284 285 286 287 288 289 290 291 292 293 294 295 296 297 298 299 300 301 302 303 304 305 306 307 308 309 310 311 312 313 314 315 316 317 318 319 320 321 322
/* SPDX-License-Identifier: GPL-2.0 * * Copyright 2016-2018 HabanaLabs, Ltd. * All Rights Reserved. * */ /************************************ ** This is an auto-generated file ** ** DO NOT EDIT BELOW ** ************************************/ #ifndef ASIC_REG_TPC1_RTR_REGS_H_ #define ASIC_REG_TPC1_RTR_REGS_H_ /* ***************************************** * TPC1_RTR (Prototype: TPC_RTR) ***************************************** */ #define mmTPC1_RTR_HBW_RD_RQ_E_ARB 0xE40100 #define mmTPC1_RTR_HBW_RD_RQ_W_ARB 0xE40104 #define mmTPC1_RTR_HBW_RD_RQ_N_ARB 0xE40108 #define mmTPC1_RTR_HBW_RD_RQ_S_ARB 0xE4010C #define mmTPC1_RTR_HBW_RD_RQ_L_ARB 0xE40110 #define mmTPC1_RTR_HBW_E_ARB_MAX 0xE40120 #define mmTPC1_RTR_HBW_W_ARB_MAX 0xE40124 #define mmTPC1_RTR_HBW_N_ARB_MAX 0xE40128 #define mmTPC1_RTR_HBW_S_ARB_MAX 0xE4012C #define mmTPC1_RTR_HBW_L_ARB_MAX 0xE40130 #define mmTPC1_RTR_HBW_RD_RS_E_ARB 0xE40140 #define mmTPC1_RTR_HBW_RD_RS_W_ARB 0xE40144 #define mmTPC1_RTR_HBW_RD_RS_N_ARB 0xE40148 #define mmTPC1_RTR_HBW_RD_RS_S_ARB 0xE4014C #define mmTPC1_RTR_HBW_RD_RS_L_ARB 0xE40150 #define mmTPC1_RTR_HBW_WR_RQ_E_ARB 0xE40170 #define mmTPC1_RTR_HBW_WR_RQ_W_ARB 0xE40174 #define mmTPC1_RTR_HBW_WR_RQ_N_ARB 0xE40178 #define mmTPC1_RTR_HBW_WR_RQ_S_ARB 0xE4017C #define mmTPC1_RTR_HBW_WR_RQ_L_ARB 0xE40180 #define mmTPC1_RTR_HBW_WR_RS_E_ARB 0xE40190 #define mmTPC1_RTR_HBW_WR_RS_W_ARB 0xE40194 #define mmTPC1_RTR_HBW_WR_RS_N_ARB 0xE40198 #define mmTPC1_RTR_HBW_WR_RS_S_ARB 0xE4019C #define mmTPC1_RTR_HBW_WR_RS_L_ARB 0xE401A0 #define mmTPC1_RTR_LBW_RD_RQ_E_ARB 0xE40200 #define mmTPC1_RTR_LBW_RD_RQ_W_ARB 0xE40204 #define mmTPC1_RTR_LBW_RD_RQ_N_ARB 0xE40208 #define mmTPC1_RTR_LBW_RD_RQ_S_ARB 0xE4020C #define mmTPC1_RTR_LBW_RD_RQ_L_ARB 0xE40210 #define mmTPC1_RTR_LBW_E_ARB_MAX 0xE40220 #define mmTPC1_RTR_LBW_W_ARB_MAX 0xE40224 #define mmTPC1_RTR_LBW_N_ARB_MAX 0xE40228 #define mmTPC1_RTR_LBW_S_ARB_MAX 0xE4022C #define mmTPC1_RTR_LBW_L_ARB_MAX 0xE40230 #define mmTPC1_RTR_LBW_RD_RS_E_ARB 0xE40250 #define mmTPC1_RTR_LBW_RD_RS_W_ARB 0xE40254 #define mmTPC1_RTR_LBW_RD_RS_N_ARB 0xE40258 #define mmTPC1_RTR_LBW_RD_RS_S_ARB 0xE4025C #define mmTPC1_RTR_LBW_RD_RS_L_ARB 0xE40260 #define mmTPC1_RTR_LBW_WR_RQ_E_ARB 0xE40270 #define mmTPC1_RTR_LBW_WR_RQ_W_ARB 0xE40274 #define mmTPC1_RTR_LBW_WR_RQ_N_ARB 0xE40278 #define mmTPC1_RTR_LBW_WR_RQ_S_ARB 0xE4027C #define mmTPC1_RTR_LBW_WR_RQ_L_ARB 0xE40280 #define mmTPC1_RTR_LBW_WR_RS_E_ARB 0xE40290 #define mmTPC1_RTR_LBW_WR_RS_W_ARB 0xE40294 #define mmTPC1_RTR_LBW_WR_RS_N_ARB 0xE40298 #define mmTPC1_RTR_LBW_WR_RS_S_ARB 0xE4029C #define mmTPC1_RTR_LBW_WR_RS_L_ARB 0xE402A0 #define mmTPC1_RTR_DBG_E_ARB 0xE40300 #define mmTPC1_RTR_DBG_W_ARB 0xE40304 #define mmTPC1_RTR_DBG_N_ARB 0xE40308 #define mmTPC1_RTR_DBG_S_ARB 0xE4030C #define mmTPC1_RTR_DBG_L_ARB 0xE40310 #define mmTPC1_RTR_DBG_E_ARB_MAX 0xE40320 #define mmTPC1_RTR_DBG_W_ARB_MAX 0xE40324 #define mmTPC1_RTR_DBG_N_ARB_MAX 0xE40328 #define mmTPC1_RTR_DBG_S_ARB_MAX 0xE4032C #define mmTPC1_RTR_DBG_L_ARB_MAX 0xE40330 #define mmTPC1_RTR_SPLIT_COEF_0 0xE40400 #define mmTPC1_RTR_SPLIT_COEF_1 0xE40404 #define mmTPC1_RTR_SPLIT_COEF_2 0xE40408 #define mmTPC1_RTR_SPLIT_COEF_3 0xE4040C #define mmTPC1_RTR_SPLIT_COEF_4 0xE40410 #define mmTPC1_RTR_SPLIT_COEF_5 0xE40414 #define mmTPC1_RTR_SPLIT_COEF_6 0xE40418 #define mmTPC1_RTR_SPLIT_COEF_7 0xE4041C #define mmTPC1_RTR_SPLIT_COEF_8 0xE40420 #define mmTPC1_RTR_SPLIT_COEF_9 0xE40424 #define mmTPC1_RTR_SPLIT_CFG 0xE40440 #define mmTPC1_RTR_SPLIT_RD_SAT 0xE40444 #define mmTPC1_RTR_SPLIT_RD_RST_TOKEN 0xE40448 #define mmTPC1_RTR_SPLIT_RD_TIMEOUT_0 0xE4044C #define mmTPC1_RTR_SPLIT_RD_TIMEOUT_1 0xE40450 #define mmTPC1_RTR_SPLIT_WR_SAT 0xE40454 #define mmTPC1_RTR_WPLIT_WR_TST_TOLEN 0xE40458 #define mmTPC1_RTR_SPLIT_WR_TIMEOUT_0 0xE4045C #define mmTPC1_RTR_SPLIT_WR_TIMEOUT_1 0xE40460 #define mmTPC1_RTR_HBW_RANGE_HIT 0xE40470 #define mmTPC1_RTR_HBW_RANGE_MASK_L_0 0xE40480 #define mmTPC1_RTR_HBW_RANGE_MASK_L_1 0xE40484 #define mmTPC1_RTR_HBW_RANGE_MASK_L_2 0xE40488 #define mmTPC1_RTR_HBW_RANGE_MASK_L_3 0xE4048C #define mmTPC1_RTR_HBW_RANGE_MASK_L_4 0xE40490 #define mmTPC1_RTR_HBW_RANGE_MASK_L_5 0xE40494 #define mmTPC1_RTR_HBW_RANGE_MASK_L_6 0xE40498 #define mmTPC1_RTR_HBW_RANGE_MASK_L_7 0xE4049C #define mmTPC1_RTR_HBW_RANGE_MASK_H_0 0xE404A0 #define mmTPC1_RTR_HBW_RANGE_MASK_H_1 0xE404A4 #define mmTPC1_RTR_HBW_RANGE_MASK_H_2 0xE404A8 #define mmTPC1_RTR_HBW_RANGE_MASK_H_3 0xE404AC #define mmTPC1_RTR_HBW_RANGE_MASK_H_4 0xE404B0 #define mmTPC1_RTR_HBW_RANGE_MASK_H_5 0xE404B4 #define mmTPC1_RTR_HBW_RANGE_MASK_H_6 0xE404B8 #define mmTPC1_RTR_HBW_RANGE_MASK_H_7 0xE404BC #define mmTPC1_RTR_HBW_RANGE_BASE_L_0 0xE404C0 #define mmTPC1_RTR_HBW_RANGE_BASE_L_1 0xE404C4 #define mmTPC1_RTR_HBW_RANGE_BASE_L_2 0xE404C8 #define mmTPC1_RTR_HBW_RANGE_BASE_L_3 0xE404CC #define mmTPC1_RTR_HBW_RANGE_BASE_L_4 0xE404D0 #define mmTPC1_RTR_HBW_RANGE_BASE_L_5 0xE404D4 #define mmTPC1_RTR_HBW_RANGE_BASE_L_6 0xE404D8 #define mmTPC1_RTR_HBW_RANGE_BASE_L_7 0xE404DC #define mmTPC1_RTR_HBW_RANGE_BASE_H_0 0xE404E0 #define mmTPC1_RTR_HBW_RANGE_BASE_H_1 0xE404E4 #define mmTPC1_RTR_HBW_RANGE_BASE_H_2 0xE404E8 #define mmTPC1_RTR_HBW_RANGE_BASE_H_3 0xE404EC #define mmTPC1_RTR_HBW_RANGE_BASE_H_4 0xE404F0 #define mmTPC1_RTR_HBW_RANGE_BASE_H_5 0xE404F4 #define mmTPC1_RTR_HBW_RANGE_BASE_H_6 0xE404F8 #define mmTPC1_RTR_HBW_RANGE_BASE_H_7 0xE404FC #define mmTPC1_RTR_LBW_RANGE_HIT 0xE40500 #define mmTPC1_RTR_LBW_RANGE_MASK_0 0xE40510 #define mmTPC1_RTR_LBW_RANGE_MASK_1 0xE40514 #define mmTPC1_RTR_LBW_RANGE_MASK_2 0xE40518 #define mmTPC1_RTR_LBW_RANGE_MASK_3 0xE4051C #define mmTPC1_RTR_LBW_RANGE_MASK_4 0xE40520 #define mmTPC1_RTR_LBW_RANGE_MASK_5 0xE40524 #define mmTPC1_RTR_LBW_RANGE_MASK_6 0xE40528 #define mmTPC1_RTR_LBW_RANGE_MASK_7 0xE4052C #define mmTPC1_RTR_LBW_RANGE_MASK_8 0xE40530 #define mmTPC1_RTR_LBW_RANGE_MASK_9 0xE40534 #define mmTPC1_RTR_LBW_RANGE_MASK_10 0xE40538 #define mmTPC1_RTR_LBW_RANGE_MASK_11 0xE4053C #define mmTPC1_RTR_LBW_RANGE_MASK_12 0xE40540 #define mmTPC1_RTR_LBW_RANGE_MASK_13 0xE40544 #define mmTPC1_RTR_LBW_RANGE_MASK_14 0xE40548 #define mmTPC1_RTR_LBW_RANGE_MASK_15 0xE4054C #define mmTPC1_RTR_LBW_RANGE_BASE_0 0xE40550 #define mmTPC1_RTR_LBW_RANGE_BASE_1 0xE40554 #define mmTPC1_RTR_LBW_RANGE_BASE_2 0xE40558 #define mmTPC1_RTR_LBW_RANGE_BASE_3 0xE4055C #define mmTPC1_RTR_LBW_RANGE_BASE_4 0xE40560 #define mmTPC1_RTR_LBW_RANGE_BASE_5 0xE40564 #define mmTPC1_RTR_LBW_RANGE_BASE_6 0xE40568 #define mmTPC1_RTR_LBW_RANGE_BASE_7 0xE4056C #define mmTPC1_RTR_LBW_RANGE_BASE_8 0xE40570 #define mmTPC1_RTR_LBW_RANGE_BASE_9 0xE40574 #define mmTPC1_RTR_LBW_RANGE_BASE_10 0xE40578 #define mmTPC1_RTR_LBW_RANGE_BASE_11 0xE4057C #define mmTPC1_RTR_LBW_RANGE_BASE_12 0xE40580 #define mmTPC1_RTR_LBW_RANGE_BASE_13 0xE40584 #define mmTPC1_RTR_LBW_RANGE_BASE_14 0xE40588 #define mmTPC1_RTR_LBW_RANGE_BASE_15 0xE4058C #define mmTPC1_RTR_RGLTR 0xE40590 #define mmTPC1_RTR_RGLTR_WR_RESULT 0xE40594 #define mmTPC1_RTR_RGLTR_RD_RESULT 0xE40598 #define mmTPC1_RTR_SCRAMB_EN 0xE40600 #define mmTPC1_RTR_NON_LIN_SCRAMB 0xE40604 #endif /* ASIC_REG_TPC1_RTR_REGS_H_ */