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 * All Rights Reserved.
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 */

/************************************
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 **       DO NOT EDIT BELOW        **
 ************************************/

#ifndef ASIC_REG_TPC2_RTR_REGS_H_
#define ASIC_REG_TPC2_RTR_REGS_H_

/*
 *****************************************
 *   TPC2_RTR (Prototype: TPC_RTR)
 *****************************************
 */

#define mmTPC2_RTR_HBW_RD_RQ_E_ARB                                   0xE80100

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#define mmTPC2_RTR_HBW_WR_RQ_E_ARB                                   0xE80170

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#define mmTPC2_RTR_HBW_RANGE_BASE_L_6                                0xE804D8

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#define mmTPC2_RTR_LBW_RANGE_MASK_7                                  0xE8052C

#define mmTPC2_RTR_LBW_RANGE_MASK_8                                  0xE80530

#define mmTPC2_RTR_LBW_RANGE_MASK_9                                  0xE80534

#define mmTPC2_RTR_LBW_RANGE_MASK_10                                 0xE80538

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#define mmTPC2_RTR_NON_LIN_SCRAMB                                    0xE80604

#endif /* ASIC_REG_TPC2_RTR_REGS_H_ */